En bref: Les applications gourmandes en données, comme l’intelligence artificielle, le calcul haute performance, les cartes graphiques haut de gamme et les serveurs, consomment de plus en plus de mémoire à large bande passante. L’association JEDEC vient de publier les caractéristiques préliminaires de la norme de 4e génération. Elle offre des gains de performances substantiels par rapport à son prédécesseur, notamment une bande passante plus élevée, une capacité accrue, une vitesse améliorée et un nombre de canaux doublé.
La semaine dernière, l’association JEDEC a publié les caractéristiques préliminaires de la mémoire à large bande passante de 4e génération. Une fois finalisée, la norme HBM4 représentera une avancée majeure dans la technologie de mémoire pour les applications de calcul haute performance. De manière tout aussi significative, la nouvelle norme définira la direction des futures technologies de mémoire et garantira l’interopérabilité entre les différents fabricants.
Le HBM4 est conçu pour améliorer encore les taux de traitement des données, en offrant une bande passante plus élevée et une capacité accrue par puce et/ou pile par rapport à son prédécesseur, le HBM3. Il vise également à maintenir une consommation d’énergie plus faible, ce qui est crucial pour les opérations de calcul à grande échelle.
Les avancées techniques incluent un nombre de canaux par pile doublé par rapport à HBM3, une empreinte physique plus importante, la compatibilité avec HBM3 via un seul contrôleur et la prise en charge des couches 24 Go et 32 Go. Il existe également un accord initial sur des vitesses allant jusqu’à 6,4 Gbps, avec des discussions sur des fréquences plus élevées. L’intégration de la mémoire HBM4 directement sur les processeurs est absente des caractéristiques, ce qui, selon Tom’s Hardware, est peut-être la partie la plus intrigante du nouveau type de mémoire.
La norme HBM4 est particulièrement importante pour l’intelligence artificielle générative, le calcul haute performance, les cartes graphiques haut de gamme et les serveurs. Les applications d’IA bénéficieront notamment des capacités de traitement de données et de mémoire qu’offrira la norme, ce qui permettra aux applications d’IA de gérer des ensembles de données plus volumineux et d’effectuer des calculs complexes plus rapidement.
La bande passante plus élevée de HBM4 permettra aux modèles d’IA de traiter les informations plus efficacement, ce qui accélérera les temps de formation et d’inférence. Par ailleurs, l’accent mis par HBM4 sur une consommation d’énergie plus faible est essentiel pour les opérations d’IA à grande échelle. En conséquence, un déploiement plus durable et plus rentable des systèmes d’IA, en particulier dans les centres de données et les environnements de calcul haute performance, sera possible.
De plus, les capacités de mémoire plus importantes par puce et par pile permettront aux applications d’IA de travailler avec des ensembles de données plus étendus et des modèles plus complexes sans nécessiter de transferts de données fréquents entre la mémoire et les unités de traitement. Enfin, les améliorations garantissent également que l’interposeur peut gérer des débits de données et une densité de signal plus élevés, ce qui se traduit par de meilleures performances globales du système pour les applications d’IA.
Il convient également de noter que le HBM4 étant conçu pour être compatible avec le HBM3 via un seul contrôleur, il facilitera l’adoption et l’intégration dans les infrastructures matérielles d’IA existantes. De plus, comme le HBM4 offre des options pour les piles TSV (Through-Silicon Via) de 4, 8, 12 et 16 niveaux, il y aura une plus grande flexibilité dans la configuration de la mémoire pour répondre aux besoins spécifiques des différentes applications d’IA.
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