SiPearl est la société française sélectionnée par le consortium européen des supercalculateurs (EuroHPC JU) pour développer une puce pour le premier supercalculateur de classe exascale de la région. L’organisation a récemment publié des caractéristiques mises à jour pour la puce Rhea1, indiquant que les premiers échantillons seront disponibles plus tard que prévu initialement.
Lors de sa participation au salon ISC à Hambourg, SiPearl a partagé les dernières caractéristiques et principales caractéristiques de la puce de supercalculateur Rhea1. Ce processeur de « première génération » utilisera la plate-forme Arm Neoverse V1, permettant les tâches de calcul haute performance des supercalculateurs européens de nouvelle génération tout en consommant moins d’énergie que les produits concurrents.
Auparavant, les caractéristiques de Rhea1 incluaient 72 cœurs Neoverse V1. Cependant, SiPearl indique désormais que la puce comportera un total de 80 cœurs Arm. Le projet Rhea1 a toujours eu pour objectif d’incorporer 80 cœurs de calcul, a précisé la société, chaque cœur contenant deux extensions vectorielles évolutives de 256 bits pour des « calculs vectoriels rapides » dans les scénarios HPC.
La conception mise à jour comprend des puces de mémoire intégrées à large bande passante avec quatre piles HBM différentes par puce. De nombreuses tâches HPC, notamment l’inférence IA, bénéficieront grandement de la RAM intégrée. SiPearl collabore avec Samsung pour utiliser les puces mémoire HBM2e, même si le fabricant coréen introduira bientôt la nouvelle norme HBM4.
En plus du HBM, les puces Rhea1 comporteront également quatre interfaces DDR5 prenant en charge deux modules DIMM supplémentaires par canal. La conception peut accueillir un total de 104 voies PCIe Gen5, avec des configurations allant jusqu’à six voies x16 plus deux voies x4. La technologie Neoverse intègre également un composant réseau sur puce spécifique, le Coherent Mesh NoC CMN-700, pour faciliter le partage rapide de données entre les éléments de calcul et d’E/S.
Rhea1 est déjà pris en charge par un large éventail de compilateurs, bibliothèques et outils. Il est capable d’alimenter à la fois les charges de travail HPC « traditionnelles » et les nouvelles tâches d’inférence d’IA. Selon la société française, la capacité de mémoire « généreuse » de la puce sera l’élément clé pour offrir des niveaux de performances accrus tout en conservant les caractéristiques d’efficacité énergétique de l’architecture Arm, ce qui se traduira par un ratio octet par FLOP sans précédent.
Ce que SiPearl n’a pas souligné, cependant, c’est que le projet Rhea était initialement prévu pour produire les premières puces réelles d’ici 2022. La société de silicium avait précédemment annoncé que les puces seraient fabriquées par TSMC en 2023, mais reporte les débuts de Rhea1 à 2025. Jupiter, le premier supercalculateur exascale européen conçu autour de l’architecture de puce de Rhea, devrait démarrer cette année.
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